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J-GLOBAL ID：200902143266134948   整理番号：00A0888856

近細粒度並列処理用シングルチップマルチプロセッサにおけるプロセッサコアの構成

Processor Core Architecture of Single Chip Multiprocessor for Near Fine Grain Parallel Processing.

著者 (4件)： 木村啓二 (早稲田大 理工) ,  内田貴之 (早稲田大 理工) ,  加藤孝幸 (本田技研) ,  笠原博徳 (早稲田大 理工)
資料名： 情報処理学会研究報告  (IPSJ SIG Technical Reports)
巻： 2000  号： 74(ARC-139)  ページ： 91-96  発行年： 2000年08月03日 
JST資料番号： Z0031B  ISSN： 0919-6072  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： 日本 (JPN)  言語： 日本語 (JA)

抄録/ポイント： 半導体集積技術の進歩に伴い,マルチプロセッサのスケーラブルな...

シソーラス用語： *マルチプロセッサシステム ,...
準シソーラス用語： プロセッサコア ,...

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分類 (2件)： ディジタル計算機方式一般  (JC02010O) ,  集積回路一般  (NC03161C)

引用文献 (21件)：

• SCHLANSKER, M. EPIC : Explicitly Parallel Instruction Computing. Computer. 2000, 33, 2, 37-45
• OKA, M. Designing and programming the emotion engine. IEEE MICRO Magazine. 1999, 19, 6, 20-28
• Sun Microsystems, Inc. MAJC Home Page. http://www.sun.com/microelectronics/MAJC/. 2000
• DIEFENDORFF, K. Power 4 focuses on memory bandwidth. Microprocessor Report. 1999, 13, 13
• HAMMOND, L. The Stanford HYDRA CMP. IEEE MICRO Magazine. 2000, 20, 2, 71-84

タイトルに関連する用語 (4件)： 細粒度 ,  並列処理 ,  チップマルチプロセッサ ,  プロセッサコア