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J-GLOBAL ID：200902277211000256   整理番号：08A0226058

情報家電用マルチコア・プロセッサ

著者 (3件)： 笠原博徳 (早稲田大 理工) ,  笠原博徳 (U. C. Berkeley) ,  笠原博徳 (U. of Illinois)
資料名： 電気学会誌  (電気学会雑誌)
巻： 128  号： 3  ページ： 172-175  発行年： 2008年03月01日 
JST資料番号： F0011A  ISSN： 1340-5551  CODEN： DGZAAW  資料種別： 逐次刊行物 (A)
記事区分： 解説  発行国： 日本 (JPN)  言語： 日本語 (JA)

抄録/ポイント： 本稿では,今後市場が急激に拡大していくと予想されている情報家電用マルチコアのアーキテクチャ,およびその実効性能の向上・低消費電力化・アプリケーションプログラムの開発期間短縮のために重要な役割を果たす並列化コンパイラ,各社のマルチコア上での並列化コンパイラの共用を可能とする情報家電用APIについて紹介した。競争力の高いコンパイラ協調型のマルチコアを開発するために,2005年度より3年間で国際競争力の高い高性能低消費電力のコンパイラ協調型マルチコアを開発するNEDO半導体アプリケーションチップ”リアルタイク情報家電用マルチコアプロジェクト”が行われている。このプロジェクトの内容に従って情報家電用マルチコアのアーキテクチャ,並列化コンパイラ,APIを説明した。

シソーラス用語： *情報家電 ,  *マルチプロセッサシステム ,  *並列処理 ,  コンパイラ ,  *システムアーキテクチャ ,  *実時間処理 ,  消費電力 ,  データ転送 ,  アクセス制御 ,  記憶制御

分類 (1件)： ディジタル計算機ハードウェア一般  (JC04010C)

引用文献 (5件)：

• 笠原博徳. OSCAR (Optimally Scheduled Advanced Multiprocessor) のアーキテクチャ. 信学論, D. 1988, J71-D, 8
• KIMURA, K. Multigrain Parallel Processing on Compiler Cooperative Chip Multiprocessor. Proc. of INTERACT-9 (2005-2). 2005
• 笠原. 最先端の自動並列化コンパイラ技術. 情報処理学会誌. 2003, 44, 4, 384-392
• ITO, M. An 8640 MIPS SoC with Independent Power-off Control of 8 CPUs and 8 RAMs by Automatic Parallelizing Compiler. ISSCC2008, 2. 2008
• 白子. マルチコアプロセッサにおけるコンパイラ制御低消費電力化手法. 情報処理学会論文誌コンピューティングシステム. 2006, 47, ACS15

タイトルに関連する用語 (3件)： 情報家電 ,  マルチコア ,  プロセッサ