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J-GLOBAL ID：200901052144988815
Update date: Apr. 18, 2024
Yahara Mitsutoshi
ヤハラ ミツトシ | Yahara Mitsutoshi
Affiliation and department：
Job title：
Professor
Research field (1)：
Electronic devices and equipment
Research keywords (3)：
電子回路
, パルス回路
, Pulse Circuit
Research theme for competitive and other funds (4)：
- 2015 - 2018 Associative Memory Using Neuron CMOS Inverters
- 2012 - 2015 High-Speed and Low Power Consumption AD Converter Using Neuron MOSFET
- ディジタル同期ループに関する研究
- Study of Digital Locked Loop
Papers (95)：
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西口大嗣, 矢原充敏, 原田裕二郎, 福原雅朗, 藤本邦昭. 配線間容量を利用したニューロン電子回路に基づく範囲内ハミング距離検索連想メモリ. 電子情報通信学会誌. 2024. Vol.J107-C. No.4. 125-132
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西口大嗣, 矢原充敏, 原田裕二郎, 福原雅朗, 藤本邦昭. 多相クロックに基づくディジタル制御発振器を用いたPLL. 電子情報通信学会誌. 2024. Vol.J107-C. No.4. 116-124
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Daishi Nishiguchi, Mitsutoshi Yahara, Yujiro Harada, Masaaki Fukuhara, Kuniaki Fujimoto. Design of Frequency Multiplier Based on Double-edge Counter and Its Analysis. ICIC Express Letters. 2024. Vol.15. No.1. 35-42
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Proposal of a high-speed Hamming distance detector using electronic neuron circuit and chip evaluation. 2023. 15. 2. 7-10
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Mitsutoshi Yahara, Kuniaki Fujimoto, Daishi Nishiguchi, Yujiro Harada, Masaaki Fukuhara. DIGITAL FREQUENCY-LOCKED LOOP WITH WIDE LOCK-IN RANGE AND LOW FREQUENCY ERROR BASED ON MULTI-PHASE CLOCK. International Journal of Innovative Computing, Information and Control. 2022. 18. 6. 1979-1988
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MISC (22)：
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西口大嗣, 矢原充敏, 藤本邦昭. タイミング計数誤差を回避したダブルエッジカウンタに関する一提案. 2020年度電子情報通信学会九州支部学生会. 2020
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On approach of high school-college partnership program using e-Learning emphasized mentoring: as an example of support of information technology engineers examination. Proceedings of the Tokai University Junior Colleges. 2009. 43. 71-78
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Kuniaki Fujimoto, Mitsutoshi Yahara, Hirofumi Sasaki, Yan Shi. A Dividing Ratio Changeable Digital PLL with Low Output Phase Noise. ICICIC2008. 2008
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矢原充敏, 藤本邦昭, 佐々木博文. A Multiplier with Low Jitter Using Multi-phase Clock Divider. ISII2008. 2008. ISII2008-244. p.31
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Fujimoto Kuniaki, Shibuya Takashi, Yahara Mitsutoshi, Sasaki Hirofumi. A-1-22 A Study on Dividing Circuit with Multi-Phase Input Clocks. Proceedings of the IEICE General Conference. 2006. 2006. 22-22
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Education (2)：
- 1991 - 1993 Kyushu Tokai University Graduate School of Engineering
- 1987 - 1991 Kyushu Tokai University School of Engineering
Professional career (1)：
Work history (2)：
- 2018/04 - 現在 Tokai University
- 2009/04 - 2018/03 東海大学福岡短期大学 教授
Committee career (1)：
- 2020/04 - 現在 電子情報通信学会九州支部 学生会顧問
Awards (4)：
- 2013/02 - 財団法人北九州産業芸術推進機構第4回ユニーク・自作チップコンテストinひびきの 優秀賞 スイッチとカレントを用いた可変分周回路
- 2011/02 - 財団法人北九州産業芸術推進機構第2回ユニーク・自作チップコンテストinひびきの 優秀賞 ブートスラップ回路による電圧制御発振器
- 2011/02 - 財団法人北九州産業芸術推進機構第2回ユニーク・自作チップコンテストinひびきの 最優秀賞 ニューロンCMOSインバータを用いたAD変換回路
- 2009/10 - 財団法人北九州産業芸術推進機構第1回ユニーク・自作チップコンテストinひびきの 優秀賞 電圧制御多相クロック発振回路
Association Membership(s) (2)：
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