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J-GLOBAL ID：200902001910001599   整理番号：89A0098483

アニーリング手法を利用した多重レベル組合せ論理の最適化

Optimization of multilevel combination logic using annealing approach.
著者 (2件)：
CHIA W-K

CHIA W-K について

(LSI Logic Corp., CA, USA)

LSI Logic Corp., CA, USA について

, 
CHOU Y-M

CHOU Y-M について

(LSI Logic Corp., CA, USA)

LSI Logic Corp., CA, USA について


資料名：
Proceedings of the IEEE Midwest Symposium on Circuits and Systems  (Proceedings of the IEEE Midwest Symposium on Circuits and Systems)

Proceedings of the IEEE Midwest Symposium on Circuits and Systems について


巻： 30th  ページ： 1070-1073  発行年： 1988年 
JST資料番号： D0551A  ISSN： 1548-3746  資料種別： 会議録 (C)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)
抄録/ポイント：
抄録/ポイント
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弱い分割手法(Weak division approach)...
シソーラス用語：
シソーラス用語/準シソーラス用語
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組合せ回路

組合せ回路 について

,...
準シソーラス用語：
シソーラス用語/準シソーラス用語
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アニーリング【データ】

アニーリング【データ】 について


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分類 (1件)：
分類
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集積回路一般 
(NC03161C)

集積回路一般 について

タイトルに関連する用語 (6件)：
タイトルに関連する用語
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アニーリング

アニーリング について

, 
手法

手法 について

, 
多重

多重 について

, 
組合せ

組合せ について

, 
論理

論理 について

, 
最適化

最適化 について


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