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J-GLOBAL ID:201702216330911866   整理番号:17A0354328

ISFETアレイ統合検出システムの読み出し回路設計に適用した。【JST・京大機械翻訳】

Design for Readout Circuit of ISFET Array Integrated Test System
著者 (9件):
資料名:
巻: 49  号:ページ: 69-73,079  発行年: 2016年 
JST資料番号: C2963A  ISSN: 0465-7942  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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ISFET(ION SENSITIVE FIELD EFFECT TRANSISTORS)はCMOSプロセスと互換性があるイオン敏感電界効果トランジスタである。センサアレイの集積度の増加とともに,応答速度,電力消費およびコストの限界のため,単一ISFETの検出回路は,大規模統合の検出システムには適していない。集積化の観点から、複数の読み出し回路を分析した上で、それぞれの性能特徴を比較し、1種類のパルス幅調節読み出し回路を得て、消費電力、変換速度と構造において優位性があり、大規模なISFETセンサアレイのデータ読み取りに適している。回路の性能を検証するために離散を使用し,FPGAにより読み出し回路の出力データを収集し,良好な安定性と実現可能性を検証した。Data from the ScienceChina, LCAS. Translated by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (4件):
分類
JSTが定めた文献の分類名称とコードです
計測機器一般  ,  トランジスタ  ,  酸塩基平衡  ,  AD・DA変換回路 

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