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J-GLOBAL ID:201702233572644250   整理番号:17A0825292

ソフトエラーの下でのSRAMベースFPGAにおけるHLSベース設計の信頼性と性能のトレードオフの解析【Powered by NICT】

Analyzing Reliability and Performance Trade-Offs of HLS-Based Designs in SRAM-Based FPGAs Under Soft Errors
著者 (9件):
資料名:
巻: 64  号:ページ: 874-881  発行年: 2017年 
JST資料番号: C0235A  ISSN: 0018-9499  CODEN: IETNAE  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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FPGAを用いたハードウェア設計の増加システムの複雑さと製品化までの時間の短縮は,高性能回路のための電流必要性を焦点とした新しい設計方法論の採用を動機づけた。高レベル合成(HLS)ツールは,高レベルのソフトウェアプログラミング言語からレジスタ転送レベル(RTL)設計を生成することができる。これらのツールは,近年顕著に進化し,最適化されたRTL設計,高い性能と高い信頼性レベルの両方を必要とする安全性重視アプリケーションのニーズに応えるを提供した。しかし,ソフトエラー下でHLSベース設計の信頼性評価はまだ提示されていない。本研究では,信頼性,資源利用,性能の点で異なるHLSベース設計のトレードオフはソフトエラーの下でそれらの挙動を解析し,SRAMベースFPGAにおける標準プロセッサ実装とそれらを比較することにより調べた。故障注入キャンペーンと放射実験から得られた結果は,断面積(8倍までの増加)の小さな影響をその構造を変化させ,システムの平均負荷間の故障(MWBF)を増加させることにより5,000倍までプロセッサシステムの性能を向上させることが可能であることを示した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (2件):
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JSTが定めた文献の分類名称とコードです
半導体の放射線による構造と物性の変化  ,  半導体集積回路 

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