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J-GLOBAL ID:201702241839338255   整理番号:17A0363290

k-平均クラスタリングアルゴリズムのためのネットワークオンチップに基づくMPSoCアーキテクチャ【Powered by NICT】

Network-on-Chip based MPSoC architecture for k-mean clustering algorithm
著者 (5件):
資料名:
巻: 46  号: PA  ページ: 1-10  発行年: 2016年 
JST資料番号: H0781A  ISSN: 0141-9331  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: オランダ (NLD)  言語: 英語 (EN)
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データと画像セグメンテーションは,機械学習の応用において重要な役割を果たす。,教師なしクラスタリングのためのツールとして,k-meansはその固有の簡単さと効率のために,セグメンテーションのための広く使用されているアルゴリズムである。k平均分割データセットの適合値に基づいてサブセット。k-平均は,フィールドプログラマブルゲートアレイ(FPGA)のようなハードウェアプラットフォーム上での実装に適したアルゴリズムであるが,高い計算時間を必要とする。ハードウエアアクセラレータは,アルゴリズムの計算の複雑さを低減するのを助けることができる。本論文では,k-meansの実装のための簡易マルチコアに基づくスケーラブルなハードウェアアーキテクチャを提案した。提案したアーキテクチャの平均と適応モジュールは,変性したk-平均クラスタリングアルゴリズムの速度をさらに増強した。変性因子はターゲットデバイスの面積を保つチェックによる選択しなければならない。提案したアーキテクチャでは,メッセージパッシングのボトルネックを上昇させる一方,コアはさらに高いスケーラビリティを可能にするチップ(NoC)相互接続ネットワーク上のネットワークを介して接続されている。MPSoCアーキテクチャの性能は,NoC相互接続を使用せずに平均高速化,平均スループットと面積消費に関して評価した。最後に,最大動作周波数,平均スループットと面積オーバヘッドに関して異なるNoC相互接続モデルの使用を比較した。Copyright 2017 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【Powered by NICT】
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分類 (1件):
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集積回路一般 
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