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J-GLOBAL ID：201702247022530934   整理番号：17A0279042

FPGAを用いたハードウェア効率のよい故障許容星状細胞神経回路網【Powered by NICT】

An FPGA-based hardware-efficient fault-tolerant astrocyte-neuron network

著者 (9件)： Johnson Anju P. (Department of Electronics, University of York, YO10 5DD, UK) ,  Halliday David M. (Department of Electronics, University of York, YO10 5DD, UK) ,  Millard Alan G. (Department of Electronics, University of York, YO10 5DD, UK) ,  Tyrrell Andy M. (Department of Electronics, University of York, YO10 5DD, UK) ,  Timmis Jon (Department of Electronics, University of York, YO10 5DD, UK) ,  Liu Junxiu (School of Computing and Intelligent Systems, Ulster University, Derry BT48 7JL, UK) ,  Harkin Jim (School of Computing and Intelligent Systems, Ulster University, Derry BT48 7JL, UK) ,  McDaid Liam (School of Computing and Intelligent Systems, Ulster University, Derry BT48 7JL, UK) ,  Karim Shvan (School of Computing and Intelligent Systems, Ulster University, Derry BT48 7JL, UK)
資料名： IEEE Conference Proceedings  (IEEE Conference Proceedings)
巻： 2016  号： SSCI  ページ： 1-8  発行年： 2016年 
JST資料番号： W2441A  資料種別： 会議録 (C)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)

抄録/ポイント： ヒト脳は修復自体能力を持つ構造化されている。脳の可塑性は,研究者フォールトトレランスと自己修復の類似した機能を備えたシステムを開発することを動機付けた。最近の研究結果は,星状細胞とニューロンとの間の相互作用は双方向に結合したアストロサイトとニューロン系における脳自己修復を操作できることを証明した。本論文では,FPGA上のバイオ影響型自己修復アーキテクチャのハードウェア実現を提案した。もFPGAを用いたハードウェア効率的なフォールトトレラントシステムのための低減アーキテクチャを導入した。これは星状細胞内のカルシウム動態を単純化することによってアストロサイトとニューロンのネットワークにおける逆行性シグナル伝達の原理に基づいている。ハードウェア実装を最適化しハードウェア利用率を90%以上減少を示し,大規模アストロサイトとニューロンのネットワークのための効率的な実装を証明した。クロックサイクル当たり0027スパイクの平均スパイク率は100%の部分故障の場合における星状細胞の両方の提案されたモデルで観察された。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】

シソーラス用語： フォールトトレランス ,  *故障 ,  ヒト ,  最適化 ,  *星状細胞 ,  簡素化 ,  構造形成 ,  *FPGA ,  ニューロン ,  *神経回路網 ,  *ハードウェア
準シソーラス用語： 利用率 ,  ハードウェア実装 ,  自己修復 ,  脳可塑性 , 【Automatic Indexing@JST】

分類 (1件)： 信頼性  (KB04040H)

タイトルに関連する用語 (6件)： FPGA ,  ハードウェア ,  故障 ,  許容 ,  星状細胞 ,  神経回路網