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J-GLOBAL ID:201702259406052211   整理番号:17A0214147

モバイルSoC応用のための0.027μm~2高密度6T SRAMセルを用いた4~日発生FinFETトランジスタを特徴とする7nm CMOSプラットフォーム技術【Powered by NICT】

A 7nm CMOS platform technology featuring 4th generation FinFET transistors with a 0.027um2 high density 6-T SRAM cell for mobile SoC applications
著者 (32件):
資料名:
巻: 2016  号: IEDM  ページ: 2.6.1-2.6.4  発行年: 2016年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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初めて,モバイルSoC応用のための前縁7nm CMOSプラットフォーム技術を紹介した。この技術は>3.3Xルートゲート密度と35%~40%の速度利得または16nm FinFET技術上の>65%の電力削減を提供する。0.027μm~2の最小高密度SRAMセルを用いた完全に機能的な256Mb SRAM試験チップは0.5Vまで実証した。4~世代FinFETトランジスタは,低消費電力と高性能設計要求を可能にするために25%~35%と多重Vtデバイスオプションによるデバイスミスマッチ低減して最適化した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (1件):
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半導体集積回路 

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