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J-GLOBAL ID:201702261379818809   整理番号:17A0880566

SDNoCのための動的タスクマッピングアルゴリズム【Powered by NICT】

A dynamic task mapping algorithm for SDNoC
著者 (2件):
資料名:
巻: 63  ページ: 58-65  発行年: 2017年 
JST資料番号: A0186A  ISSN: 0026-2692  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: イギリス (GBR)  言語: 英語 (EN)
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タスクマッピングはネットワークオンチップ(NoC)のシステム性能に大きな影響を与える。本論文では,ソフトウェア定義ネットワークオンチップ(SDNoC)のための動的タスクマッピングアルゴリズムを提案した。SDNoCの階層的設計は,NoCの柔軟性を促進し,ソフトウェア技術を用いた動的マッピングアルゴリズムの走行環境を提供している。動的タスクマッピングの目的は,アプリケーション実行の通信コストを最小化し,ルータ間の負荷バランスを達成することである。応用のタスクは,ルータ間の最小通信コストとフリット負荷バランスのための提案されたタスクの粗いマッピングとタスク微細マッピングによる適切なネットワークノードに帰属した。シミュレーションプラットフォームにより提案アプローチの有効性を確認するために提示した。シミュレーション結果は,通信コストとルータフリット負荷の標準偏差は報告された動的マッピング法と比較して2.8%および8.1%減少したことを示した。アプリケーションの実行時間とマッピングの時間消費はそれぞれ報告された動的マッピングと比較して9.3%と28.2%であった。Copyright 2017 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【Powered by NICT】
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, 【Automatic Indexing@JST】
分類 (1件):
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半導体集積回路 

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