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J-GLOBAL ID:201702279453554373   整理番号:17A0054928

低電力ディジタルシステムのための改善された過渡性能を持つサブ1V低ドロップアウトレギュレータ【Powered by NICT】

A sub-1V low dropout regulator with improved transient performance for low power digital systems
著者 (3件):
資料名:
巻: 2016  号: APCCAS  ページ: 29-32  発行年: 2016年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,低電圧フリップ電圧フォロワ(FVF)に基づく出力キャパシタレス低ドロップアウト(OCL LDO)レギュレータを提案した。低静止電力での応答を改善するための過渡増強プッシュプル(TEPP)駆動段から構成されている。簡単なMiller補償(SMC)と修正減衰率制御(DFC)で補償され,調節因子は異なる荷重条件の下での回路安定性を維持するために小さい補償容量を可能にする設計の柔軟性を増加させる。UMC65nm CMOS技術により検証し,調節因子は100pF~3nFへの容量性負荷を支援することができる。は0.9V電源で200mVのドロップアウト電圧と20μA以下の静止電流10mAの最大負荷電流を供給した。レギュレータの出力電圧は負荷電流遷移中の最終定常状態電圧レベルの1%以内であった。他の報告された対応物と比較して,合理的な良好な過渡性能指数(FOMs)を示し,低電力ディジタルシステムに特に適している。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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電源回路 
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