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文献
J-GLOBAL ID:201402289037312241   整理番号:14A1296182

PEACH2への演算機構の実装とその性能評価

Evaluation and Implementation of the Calculation Feature to PEACH2
著者 (4件):
資料名:
巻: 114  号: 223(RECONF2014 17-33)  ページ: 63-68  発行年: 2014年09月11日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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PEACH2(PCI-Express Adaptive Communication Hub2)は,異なったノードに接続されたアクセラレータ間のデータ交換を,PCIeで直接行うことにより,低遅延,高バンド幅のネットワークを実現するスイッチである。PEACH2は,Altera社の大規模なFPGAであるStratix VIを用いて実装されており,その余剰ロジックを用いて演算機構を実装することで,アプリケーションの高速化を行うことが可能である。本研究では,PEACH上に演算機構を実装し,その性能評価を行なった。演算機構として,簡易なリダクションモジュールを実装し,PEACH2上のAvalon-MMバスに対して接続した。性能評価では,GPU上のデータをPEACH2で演算した際の実行時間とCPUで演算した際の実行時間を比較した。その結果小さなデータサイズでの転送において,CPU実行に対して最大45倍の性能を得られた。(著者抄録)
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分類 (2件):
分類
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入出力インタフェイス  ,  専用演算制御装置 
引用文献 (7件):
タイトルに関連する用語 (2件):
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