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J-GLOBAL ID:201702218519915806   整理番号:17A0213509

重複検出遅延を伴う切り替えシステムのための非同期推定器の設計【Powered by NICT】

Asynchronous estimator design for switched systems with overlapped detection delay
著者 (2件):
資料名:
巻: 2016  号: ICARCV  ページ: 1-6  発行年: 2016年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,非同期状態推定の問題は,時変重複検出遅れをもつゆっくりした交換システムのクラスについて調べた。スイッチング信号は平均滞留時間スイッチングを満足する。新しく提案された重複検出遅延は検出遅延を可能にする1つ以上の以前の検出遅延の終了前に開始した。項非同期を実行推定量は活性サブシステム(交換システムのモードと呼ばれるサブシステム)と不整合できることを状況に言及した。不整合推定量の最大全実行時間を考慮推定誤差システムの安定性を保証するために提供した。そのような限界により,最終推定誤差システムが世界的にある平均滞留時間スイッチング信号のための安定な均一指数的に増加することように設計されている非同期推定器。数値例は設計された推定器の有効性を示すために提供し,選択したパラメータは不整合推定器の許容全実行時間に影響を及ぼすかを検討した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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, 【Automatic Indexing@JST】
分類 (1件):
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システム設計・解析 

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