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J-GLOBAL ID:201702243812544437   整理番号:17A0809473

GPS高周波受信チップにおける低出力耗圧控発振器の設計【JST・京大機械翻訳】

A Low Power Voltage Controlled Oscillator for RF Receiver in GPS
著者 (5件):
資料名:
巻: 39  号:ページ: 790-792  発行年: 2009年 
JST資料番号: C2386A  ISSN: 1004-3365  CODEN: WEIDFK  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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本論文では,GPS受信機のための低消費電力リングリング発振器を設計した。ループは5段差分構造の増幅器から構成される。チップはTSMC 0.18ΜM CMOSプロセスを採用し、コア回路の面積は0.25 MM×0.05 MMである。試験結果により,1.75Vの電力供給において,回路の電力消費は約9.2MWであり,発振器の中心周波数は62MHZであり,位相雑音は-89.39DBC/HZ@1MHZであり,VCOはPLLと周波数シンセサイザに適用できることを示した。Data from the ScienceChina, LCAS. Translated by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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発振回路  ,  半導体集積回路 
タイトルに関連する用語 (4件):
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