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文献
J-GLOBAL ID：200902021949835544
整理番号：86A0009489
サブns速度に対する差動分割水準CMOS論理
Differential split-level CMOS logic for subnanosecond speeds.
PFENNINGS L C M G
(Philips, The Netherlands)
,
MOL W G J
(Philips, The Netherlands)
,
BASTIAENS J J J
(Philips, The Netherlands)
,
VAN DIJK J M F
(Philips, The Netherlands)
資料名：
IEEE Journal of Solid-State Circuits
(IEEE Journal of Solid-State Circuits)
巻： 20 号： 5 ページ： 1050-1055 発行年： 1985年10月
JST資料番号： B0761A ISSN： 0018-9200 CODEN： IJSCBC 資料種別： 逐次刊行物 (A)
記事区分： 原著論文 発行国： アメリカ合衆国 (USA) 言語： 英語 (EN)
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