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文献
J-GLOBAL ID：201002252820946040
整理番号：10A1065989
65nm CMOSにおける3ワット39.8~44.6Gb/s二重モードSFI5.2SerDesチップセット
A 3 Watt 39.8-44.6Gb/s Dual-Mode SFI5.2 SerDes Chip Set in 65nm CMOS
NEDOVIC Nikola
(Fujitsu Lab. America, CA, USA)
,
KRISTENSSON Anders
(Fujitsu Lab. America, CA, USA)
,
PARIKH Samir
(Fujitsu Lab. America, CA, USA)
,
REDDY Subodh
(Fujitsu Lab. America, CA, USA)
,
MCLEOD Scott
(Fujitsu Lab. America, CA, USA)
,
TZARTZANIS Nestoras
(Fujitsu Lab. America, CA, USA)
,
KANDA Kouichi
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
YAMAMOTO Takuji
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
MATSUBARA Satoshi
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
KIBUNE Masaya
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
DOI Yoshiyasu
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
IDE Satoshi
(Fujitsu Ltd., Kawasaki, JPN)
,
TSUNODA Yukito
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
YAMABANA Tetsuji
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
SHIBASAKI Takayuki
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
TOMITA Yasumoto
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
HAMADA Takayuki
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
SUGAWARA Mariko
(Fujitsu Ltd., Kawasaki, JPN)
,
IKEUCHI Tadashi
(Fujitsu Ltd., Kawasaki, JPN)
,
KUWATA Naoki
(Fujitsu Ltd., Kawasaki, JPN)
,
TAMURA Hirotaka
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
OGAWA Junji
(Fujitsu Lab. Ltd., Kawasaki, JPN)
,
WALKER William
(Fujitsu Lab. America, CA, USA)
資料名：
IEEE Journal of Solid-State Circuits
(IEEE Journal of Solid-State Circuits)
巻： 45 号： 10 ページ： 2016-2029 発行年： 2010年10月
JST資料番号： B0761A ISSN： 0018-9200 CODEN： IJSCBC 資料種別： 逐次刊行物 (A)
記事区分： 原著論文 発行国： アメリカ合衆国 (USA) 言語： 英語 (EN)
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