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文献
J-GLOBAL ID：201102265230400818
整理番号：11A1161321
65nm CMOSによる256×6bメモリ内蔵56GS/s 6b DAC
A 56GS/s 6b DAC in 65nm CMOS with 256×6b Memory
GRESHISHCHEV Yuriy M.
(Ciena, Ottawa, CAN)
,
POLLEX Daniel
(Ciena, Ottawa, CAN)
,
WANG Shing-Chi
(Ciena, Ottawa, CAN)
,
BESSON Marinette
(Ciena, Ottawa, CAN)
,
FLEMEKE Philip
(Ciena, Ottawa, CAN)
,
SZILAGYI Stefan
(Ciena, Ottawa, CAN)
,
AGUIRRE Jorge
(Ciena, Ottawa, CAN)
,
FALT Chris
(Ciena, Ottawa, CAN)
,
BEN-HAMIDA Naim
(Ciena, Ottawa, CAN)
,
GIBBINS Robert
(Ciena, Ottawa, CAN)
,
SCHVAN Peter
(Ciena, Ottawa, CAN)
資料名：
Digest of Technical Papers. IEEE International Solid-State Circuits Conference
(Digest of Technical Papers. IEEE International Solid-State Circuits Conference)
巻： 2011 ページ： 194-195,195A 発行年： 2011年
JST資料番号： D0753A ISSN： 0193-6530 資料種別： 会議録 (C)
記事区分： 短報 発行国： アメリカ合衆国 (USA) 言語： 英語 (EN)
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