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J-GLOBAL ID：201302232702088545 整理番号：13A0787291

フォールト解析対策回路を対象としたハードウェアトロイの実装と評価

Trojan Circuit for Fault Analysis Countermeasure and its Implementation

著者 (4件)：

塚平峻矢

(名城大)

松島大祐

(名城大)

熊木武志

(立命館大理工)

吉川雅弥

(名城大)

資料名：

電子情報通信学会技術研究報告 (IEICE Technical Report (Institute of Electronics, Information and Communication Engineers))

巻： 112 号： 451(VLD2012 136-162) ページ： 141-146 発行年： 2013年02月25日
JST資料番号： S0532B ISSN： 0913-5685 資料種別：会議録 (C)
記事区分：原著論文発行国：日本 (JPN) 言語：日本語 (JA)

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