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J-GLOBAL ID：201502294342685725 整理番号：15A0598898

薄膜BOX-SOIにおける論理合成対象電圧の選択によるエネルギー最小化

Energy minimization by voltage choice targeted for logic synthesis in silicon on thin buried oxide

著者 (2件)：

川崎純

(芝浦工大大学院理工学研究科)

宇佐美公良

(芝浦工大工)

資料名：

電子情報通信学会技術研究報告 (IEICE Technical Report (Institute of Electronics, Information and Communication Engineers))

巻： 114 号： 476(VLD2014 153-184) ページ： 147-152 発行年： 2015年02月23日
JST資料番号： S0532B ISSN： 0913-5685 資料種別：会議録 (C)
記事区分：原著論文発行国：日本 (JPN) 言語：日本語 (JA)

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