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文献
J-GLOBAL ID：201802240961757730
整理番号：18A0727000
ジッタ系列から正確なビット誤り率(BER)へのDDR5信号のモデリング【JST・京大機械翻訳】
Modeling of DDR5 signaling from jitter sequences to accurate bit error rate (BER)
Aydiner Alaeddin A.
(Intel Corporation)
,
Chu Yunhui
(Intel Corporation)
,
Mikulchenko Oleg
(Intel Corporation)
,
Yan Jin
(Intel Corporation)
,
Friar Robert J.
(Intel Corporation)
,
Fu Ellen Yan
(Intel Corporation)
資料名：
IEEE Conference Proceedings
(IEEE Conference Proceedings)
巻： 2017 号： EPEPS ページ： 1-3 発行年： 2017年
JST資料番号： W2441A 資料種別： 会議録 (C)
記事区分： 原著論文 発行国： アメリカ合衆国 (USA) 言語： 英語 (EN)
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