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J-GLOBAL ID:201302225951014873   整理番号:13A1793788

高電圧ストレスによるSRAMセル安定性の製造後の自己改良の実験的実証

Experimental Demonstration of Post-Fabrication Self-Improvement of SRAM Cell Stability by High-Voltage Stress
著者 (4件):
資料名:
巻: E96-C  号:ページ: 759-765 (J-STAGE)  発行年: 2013年 
JST資料番号: L1370A  ISSN: 0916-8524  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 英語 (EN)
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製造後の高電圧ストレスによるスタティックランダムアクセスメモリ(SRAM)セルの安定性の自己改良を実験的に実証し,その機構を4kのデバイスマトリックスアレイ(DMA)のSRAMテストエレメントグループ(TEG)を用いて解析した。不平衡セルの安定性が単にSRAMのVDD端子にストレス電圧を印加することによって自動的に改良することを示した。SRAMセルにおけるOFF状態のpFETの|VTH|が選択的に低下し,それがセルの安定性を改良し,自己改良に寄与することが新たにわかった。(翻訳著者抄録)
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分類 (3件):
分類
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半導体集積回路  ,  トランジスタ  ,  信頼性 

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