特許
J-GLOBAL ID:201703017215847622
電界効果トランジスタ及び電界効果トランジスタの製造方法
発明者:
,
出願人/特許権者:
代理人 (6件):
山田 威一郎
, 立花 顕治
, 田中 順也
, 松井 宏記
, 山下 未知子
, 桝田 剛
公報種別:公開公報
出願番号(国際出願番号):特願2015-145514
公開番号(公開出願番号):特開2017-028115
出願日: 2015年07月23日
公開日(公表日): 2017年02月02日
要約:
【課題】窒化物半導体のヘテロ接合を利用した電界効果トランジスタの性能を向上可能な技術を提供する。【解決手段】電界効果トランジスタ1は、基板11と、基板11の上方に形成される第1窒化物半導体層12と、第1窒化物半導体層12上に積層され、第1窒化物半導体層12よりも大きいバンドギャップエネルギーを有する第2窒化物半導体層13と、第2窒化物半導体層13上に異種材料接合により接合された、窒化物半導体とは他種の半導体で構成されたp型半導体層21と、p型半導体層21に接続するゲート電極14と、ゲート電極14の両側に配置され、第2窒化物半導体層13にそれぞれ接続するソース電極15及びドレイン電極16と、を備える。【選択図】図1
請求項(抜粋):
基板と、
前記基板の上方に形成される第1窒化物半導体層と、
前記第1窒化物半導体層上に積層され、前記第1窒化物半導体層よりも大きいバンドギャップエネルギーを有する第2窒化物半導体層と、
前記第2窒化物半導体層上に異種材料接合により接合された、窒化物半導体とは他種の半導体で構成されたp型半導体層と、
前記p型半導体層に接続するゲート電極と、
前記ゲート電極の両側に配置され、前記第2窒化物半導体層にそれぞれ接続するソース電極及びドレイン電極と、
を備える、
電界効果トランジスタ。
IPC (6件):
H01L 21/338
, H01L 29/778
, H01L 29/812
, H01L 21/337
, H01L 27/098
, H01L 29/808
FI (2件):
H01L29/80 H
, H01L29/80 C
Fターム (17件):
5F102GB01
, 5F102GC01
, 5F102GD01
, 5F102GD05
, 5F102GJ02
, 5F102GJ03
, 5F102GJ04
, 5F102GL04
, 5F102GM02
, 5F102GM04
, 5F102GM05
, 5F102GM08
, 5F102GN02
, 5F102GN05
, 5F102GQ01
, 5F102GR01
, 5F102GS04
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