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J-GLOBAL ID:202202259592675536   整理番号:22A1745395

65-nm CMOSプロセスを用いた局部帰還構成RGC-TIA

Regulated Cascode Transimpedance Amplifier with Local Feedback Loop in 65-nm CMOS Process
著者 (6件): ,  ,  ,  ,  , 
資料名:
号: ECT-22-023-039 電子回路研究会  ページ: 51-55 (WEB ONLY)  発行年: 2022年06月06日 
JST資料番号: U2358A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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本論文では,65nm CMOSプロセスを用いた安定化カスコード構成(RGC)に基づくトランスインピーダンス増幅器(TIA)の設計と評価を報告する。提案したRGC-TIA回路は,RGC出力段階の端末に局部フィードバック負帰還回路を加えることにより,より広い帯域幅を持つ。レイアウト後のシミュレーション結果から,提案したTIAは,46dBΩの利得,11.4GHzの-3dB周波数を持つ。15Gb/sアイダイアグラムを,作製したチップ測定から得た。(翻訳著者抄録)
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分類 (1件):
分類
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増幅回路 
引用文献 (10件):
  • 総務省,我が国のインターネットにおけるトラヒックの集計・試算 (2020年1月時点の集計結果の公表), https://www.soumu.go.jp/joho_tsusin/eidsystem/
  • G.-S. Jeong, H. Chi, K. Kim, and D.-K. Jeong, “A 20-Gb/s 1.27pJ/b low-power optical receiver front-end in 65nm CMOS,” Proc. of IEEE International Symposium on Circuits and Systems (ISCAS) 2014, Melbourne, VIC, Australia, June 1-5, DOI: 10.1109/ISCAS.2014.6865429 (2014-5).
  • W. Ahmad, M. Abdulaziz, M. Törmänen, H. Sjöland, “CMOS adaptive TIA with embedded single-ended to differential conversion for analog optical links,” Proc. of IEEE ISCAS 2015, Lisbon, Portugal, May 24-27, DOI: 10.1109/ISCAS.2015.7168719 (2015-5).
  • J.L. González, R. Polster, G. Waltener, Y. Thonnart, and E. Cassan, “10 Gbps, 560 fJ/b TIA and modulator driver for optical networks-on-chip in CMOS 65nm,” Proc. of IEEE International New Circuits and Systems Conference 2016, Vancouver, Canada, June 26-29, DOI: 10.1109/NEWCAS.2016.7604796 (2016-6).
  • R. Costanzo, and S.M. Bowers, “A current reuse regulated cascode CMOS transimpedance amplifier with 11-GHz bandwidth,” IEEE Microw. Wirel. Compon. Lett., vol. 28, pp. 816-818, DOI: 10.1109/LMWC. 2018.2854594 (2018-9).
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