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J-GLOBAL ID：200902104134282373   整理番号：99A0866552

回路設計,トランジスタ寸法決定およびFPGA相互配線の配線レイアウト

Circuit Design, Transistor Sizing and Wire Layout of FPGA Interconnect.
著者 (2件)：
BETZ V

BETZ V について

(Univ. Toronto, Ontario, CAN)

Univ. Toronto, Ontario, CAN について

, 
ROSE J

ROSE J について

(Univ. Toronto, Ontario, CAN)

Univ. Toronto, Ontario, CAN について


資料名：
Proceedings of the IEEE Custom Integrated Circuits Conference  (Proceedings of the IEEE Custom Integrated Circuits Conference)

Proceedings of the IEEE Custom Integrated Circuits Conference について


巻： 1999  ページ： 171-174  発行年： 1999年 
JST資料番号： H0843A  ISSN： 0886-5930  資料種別： 会議録 (C)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)
抄録/ポイント：
抄録/ポイント
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FPGAの相互配線回路の電気的設計問題を検討した。最初にパス...
シソーラス用語：
シソーラス用語/準シソーラス用語
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*FPGA

FPGA について

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準シソーラス用語：
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相互配線

相互配線 について

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分類 (1件)：
分類
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集積回路一般 
(NC03161C)

集積回路一般 について

タイトルに関連する用語 (5件)：
タイトルに関連する用語
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回路設計

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トランジスタ

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, 
FPGA

FPGA について

, 
相互配線

相互配線 について

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レイアウト

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