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J-GLOBAL ID：200902112316937467   整理番号：93A0623177

フラッシュEEPROMにおけるスピードを最適化するアレイアーキテクチャ

Speed optimised array architecture for flash EEPROMs.
著者 (1件)：
AMIN A A M

AMIN A A M について

(King Fahd Univ. Petroleum & Minerals, Dhahran, SAU)

King Fahd Univ. Petroleum & Minerals, Dhahran, SAU について


資料名：
IEE Proceedings. Part G. Circuits, Devices and Systems  (IEE Proceedings. Part G. Circuits, Devices and Systems)

IEE Proceedings. Part G. Circuits, Devices and Systems について


巻： 140  号： 3  ページ： 177-181  発行年： 1993年06月 
JST資料番号： A0160B  ISSN： 0143-7089  CODEN： IPGSEB  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： イギリス (GBR)  言語： 英語 (EN)
抄録/ポイント：
抄録/ポイント
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スプリットゲートフラッシュEEPROMメモリアレイにおける,...
シソーラス用語：
シソーラス用語/準シソーラス用語
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EEPROM

EEPROM について

,...
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分類 (2件)：
分類
JSTが定めた文献の分類名称とコードです
半導体集積回路 
(NC03162T)

半導体集積回路 について

,  記憶装置 
(JC04060F)

記憶装置 について

タイトルに関連する用語 (6件)：
タイトルに関連する用語
J-GLOBALで独自に切り出した文献タイトルの用語をもとにしたキーワードです
フラッシュ

フラッシュ について

, 
EEPROM

EEPROM について

, 
スピード

スピード について

, 
最適化

最適化 について

, 
アレイ

アレイ について

, 
アーキテクチャ

アーキテクチャ について


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