プロセッサ間通信用2Gb/s 21CH低待ち時間トランシーバ回路

TANAHASHI T; KURISU M; YAMAGUCHI H; NEDACHI T; ARAI M; TOMARI S; MATSUZAKI T; NARAMOTO S; SATO T

文献

J-GLOBAL ID：200902129818713295 整理番号：01A0546612

プロセッサ間通信用2Gb/s 21CH低待ち時間トランシーバ回路

A 2Gb/s 21CH Low-Latency Transceiver Circuit for Inter-Processor Communication.

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Digest of Technical Papers. IEEE International Solid-State Circuits Conference (Digest of Technical Papers. IEEE International Solid-State Circuits Conference)

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巻： 44 ページ： 60-61,430 発行年： 2001年02月
JST資料番号： D0753A ISSN： 0193-6530 資料種別：会議録 (C)
記事区分：短報発行国：アメリカ合衆国 (USA) 言語：英語 (EN)

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