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J-GLOBAL ID:200902143064785653   整理番号:99A0201814

FADDEEVAアルゴリズムに基づく滞在時間最小型カルマンフィルタのVLSIアーキテクチャ

VLSI Architecture of Kalman Filters with Minimum Latency Based on FADDEEVA Algorithm.
著者 (3件):
資料名:
巻: 34  号: 12  ページ: 1913-1921  発行年: 1998年12月 
JST資料番号: S0104A  ISSN: 0453-4654  CODEN: KJSRA  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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カルマンフィルタの適用に際して問題となる滞在時間を減少させる...
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分類 (2件):
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フィルタ一般  ,  集積回路一般 
引用文献 (12件):
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