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J-GLOBAL ID：200902194685635152   整理番号：98A0569391

抵抗性相互接続における遅延と電力を減らす中継器の設計

Repeater Design to Reduce Delay and Power in Resistive Interconnect.
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著者 (2件)：
ADLER V

ADLER V について

(Univ. Rochester, NY, USA)

Univ. Rochester, NY, USA について

, 
FRIEDMAN E G

FRIEDMAN E G について

(Univ. Rochester, NY, USA)

Univ. Rochester, NY, USA について


資料名：
IEEE Transactions on Circuits and Systems 2: Analog and Digital Signal Processing  (IEEE Transactions on Circuits and Systems 2: Analog and Digital Signal Processing)

IEEE Transactions on Circuits and Systems 2: Analog and Digital Signal Processing について


巻： 45  号： 5  ページ： 607-616  発行年： 1998年05月 
JST資料番号： W0347A  CODEN： ICSPE5  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)
抄録/ポイント：
抄録/ポイント
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大規模チップの性能を制限する長い抵抗性相互接続配線の遅延時間...
シソーラス用語：
シソーラス用語/準シソーラス用語
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相互接続

相互接続 について

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準シソーラス用語：
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SPICE

SPICE について

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分類 (2件)：
分類
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その他の電子回路 
(NC05090X)

その他の電子回路 について

,  集積回路一般 
(NC03161C)

集積回路一般 について

タイトルに関連する用語 (5件)：
タイトルに関連する用語
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相互接続

相互接続 について

, 
遅延

遅延 について

, 
中継器

中継器 について

, 
設計

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