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J-GLOBAL ID:200902203737131360 整理番号:05A0842211
安定性を考慮したAWE法
Stability Preserving AWE Method
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著者 (2件):
鈴木五郎
鈴木五郎 について
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堀口和己
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資料名:
電子情報通信学会論文誌 A (IEICE Transaction on Fundamentals of Electronics, Communications and Computer Sciences (Japan Edition))
電子情報通信学会論文誌 A について
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巻:
J88-A
号:
10
ページ:
1174-1177
発行年:
2005年10月01日
JST資料番号:
S0621A
ISSN:
0913-5707
資料種別:
逐次刊行物 (A)
記事区分:
短報
発行国:
日本 (JPN)
言語:
日本語 (JA)
抄録/ポイント:
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デープサブミクロン化が進むVLSIの設計において,ゲート遅延...
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分類 (1件):
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引用文献 (10件):
CELIK, M. IC Interconnect analysis. 2002
CHENG, C. Interconnect analysis and synthesis. 2000
ISMAIL, Y. I. On-chip inductance in high speed integrated circuits. 2001
PILEGGI, L. Asymptotic waveform evaluation for timing analysis. IEEE Trans. Comput.-Aided Des. Integr. Circuits Syst. 1990, 9, 4, 352-366
SUZUKI, G. AWE法を用いたVLSI配線遅延解析. 第67回情処全大, 2005. 2005
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