半導体記憶装置および同期型半導体記憶装置

発明者： , , ,
出願人/特許権者：
代理人 (1件)：深見久郎 (外3名)
公報種別：公開公報
出願番号（国際出願番号）：特願平5-084591
公開番号（公開出願番号）：特開平6-076567
出願日： 1993年04月12日
公開日（公表日）： 1994年03月18日
要約：

【要約】【目的】小チップ面積、高速、低消費電力かつ多機能な同期型半導体記憶装置を提供することを目的とする。【構成】メモリアレイ6a、6bは各々互いに独立に動作可能なバンクに分割される。各バンク#1および#2に対して独立に動作する読出データ格納用レジスタ10a、10bおよび書込データ格納用レジスタ16aおよび16bが設けられる。メモリアレイは複数の小アレイブロックに分割され、各アレイブロックに対応してローカルIO線が配置され、ローカルIO線はグローバルIO線に接続される。グローバルIO線はプリアンプ群8a、8bおよびライトバッファ群14aおよび14bに接続される。制御信号発生回路20、22およびレジスタ制御回路28により、連続書込動作時における所望のビットのみの書込の禁止、連続書込においてラップ長未満でデータ書込を中止する場合の最終データ入力時点での一括した選択メモリセルへの書込みおよび、ライトサイクルが繰返し実行される場合のメモリアレイの活性化のタイミングの遅延などが実現される。

請求項（抜粋）：

一連のパルス列からなるクロック信号に同期して、制御信号、アドレス信号および入力データを含む外部信号を取込む同期型半導体記憶装置であって、複数のメモリセルを有するメモリセルアレイ、前記メモリセルアレイは、各々が互いに活性化およびプリチャージ動作が独立して実行される複数のバンクに分割され、前記複数のバンクの各々に対応して設けられ、対応のバンクへの書込データを格納するための複数の書込データレジスタ手段、および前記複数のバンクの各々に対応して設けられ、対応のバンクからの読出データを格納するための複数の読出データレジスタ手段を備える、同期型半導体記憶装置。

IPC (2件)：

G11C 11/401 , G06F 12/06 570

引用特許：

審査官引用 (5件)

特開平3-137886
特開平2-044597
特開昭62-223891

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