特許
J-GLOBAL ID：200903058127286756
記憶サブシステム
発明者：
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出願人/特許権者：
代理人 (1件)：
小川 勝男
公報種別：公開公報
出願番号（国際出願番号）：特願平10-118127
公開番号（公開出願番号）：特開平11-312058
出願日： 1998年04月28日
公開日（公表日）： 1999年11月09日
要約：
【要約】【課題】複数ホスト複数パス構成での冗長構成の制御装置との接続は、論理ボリュームを共有するしないによらず、各部分の障害時、処理の続行は可能であるが、正常時のオーバヘッドの増加により、シングル構成時との性能差が問題となっている。【解決手段】デュアルコントローラ構成、複数ポート構成のディスクアレイ装置で複数ホストに冗長構成として接続された時、論理ボリュームの割当てをコントローラ間で分割してコントローラ毎に論理ボリュームを分担する。ホスト、バス、コントローラ、キャッシュ障害時でも、ホスト接続環境により障害時の切替え手段を複数の提供し、場合によっては切替えないようにする。そして、冗長構成においても、正常時もシングル構成と変わらない低オーバヘッドと、各種障害時の切替え処理における性能劣化を防ぐことを実現する。
請求項（抜粋）：
記憶領域が複数の論理ボリュームに分割される記憶装置群と、ホストコンピュータに接続され、前記ホストコンピュータと記憶装置との間を転送されるデータを一時的に保存するキャッシュメモリを有するコントローラを複数有し、前記複数のコントローラが前記記憶装置群を制御する記憶サブシステムにおいて、前記コントローラは、処理を担当する前記論理ボリュームを割り当てられ、前記キャッシュメモリに複数の前記コントローラのための記憶領域を有することを特徴とする記憶サブシステム。
IPC (4件)：
G06F 3/06 304
, G06F 11/20 310
, G06F 12/08
, G06F 12/16 310
G06F 3/06 304 B
, G06F 11/20 310 F
, G06F 12/08 G
, G06F 12/08 J
, G06F 12/16 310 J
