特許
J-GLOBAL ID：200903065628117640
マルチプロセッサシステム
発明者：
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出願人/特許権者：
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代理人 (1件)：
佐藤 幸男
公報種別：公開公報
出願番号（国際出願番号）：特願平4-148113
公開番号（公開出願番号）：特開平5-324363
出願日： 1992年05月14日
公開日（公表日）： 1993年12月07日
要約：
【要約】【目的】 バージョンデータの比較検討を人手により実施する必要がなく、さらにはバージョンの不整合に気付かずに運用を継続してしまう事態を回避することのできるマルチプロセッサシステムを提供する。【構成】 スレーブプロセッサ6のバージョンを示すバージョンデータ表示部E3と、メインプロセッサ1が、メインプロセッサ1と共同した処理の起動を制限するスレーブプロセッサ6を特定するためのバージョンを示すバージョン制限データ表示部E1と、メインプロセッサ1とスレーブプロセッサ6が、共同して実施する処理の起動前に、バージョンデータ表示部E3の内容とバージョン制限データ表示部E1の内容を照合し、照合の結果、処理に支障を来すバージョン関係の場合、処理の起動を許容しない判定を下す整合判定部とを備えたものである。
請求項（抜粋）：
メインプロセッサと、当該メインプロセッサに制御されるスレーブプロセッサが、共同して処理を実行するものであって、前記スレーブプロセッサのバージョンを示すバージョンデータ表示部と、前記メインプロセッサが前記処理を制限する前記バージョンを特定するバージョン制限データ表示部と、前記バージョンデータ表示部の読取り結果と前記バージョン制限データ表示部の読取り結果を照合し、前記処理の実行可否を判定する整合判定部を備えたことを特徴とするマルチプロセッサシステム。
IPC (2件)：
G06F 11/00 310
, G06F 15/16 470
