特許
J-GLOBAL ID:200903067917314597

アドレスデコーダ回路

発明者:
出願人/特許権者:
代理人 (1件): 佐藤 隆久
公報種別:公開公報
出願番号(国際出願番号):特願平5-238525
公開番号(公開出願番号):特開平6-338197
出願日: 1993年09月24日
公開日(公表日): 1994年12月06日
要約:
【要約】【目的】高集積化を図れ、各種モードによる動作を実現できるアドレスデコーダ回路を実現する。【構成】印加する電源電圧が任意の値に設定され、トランジスタPT11,NT11などにより選択時の出力電圧を切り替えて出力するアドレス選択回路1と、入力と出力とが交差結合された一対のCMOSインバータからなるレベル変換回路3aと、アドレス選択回路1とレベル変換回路3との間に設けられた1個のnチャネルMOSトランジスタNT21a から構成された転送ゲート2aとを設ける。これにより、回路面積の縮小化を図る。
請求項(抜粋):
印加する電源電圧が任意の値に設定され、トランジスタにより選択時の出力電圧を切り替えて出力するアドレス選択回路と、入力と出力とが交差結合された一対のCMOSインバータからなるレベル変換回路と、上記アドレス選択回路とレベル変換回路との間に設けられた1個のトランジスタからなる転送ゲートとを有することを特徴とするアドレスデコーダ回路。
IPC (3件):
G11C 16/06 ,  G11C 11/34 ,  H03K 5/02
FI (2件):
G11C 17/00 309 J ,  G11C 11/34

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