特許
J-GLOBAL ID：200903070469732626
表示装置
発明者：
出願人/特許権者：
代理人 (1件)：
鈴江 武彦
公報種別：公開公報
出願番号（国際出願番号）：特願平7-235626
公開番号（公開出願番号）：特開平9-081083
出願日： 1995年09月13日
公開日（公表日）： 1997年03月28日
要約：
【要約】【課題】応答速度の高速化のために必要とするメモリー容量を削減した液晶表示装置を提供する。【解決手段】液晶表示装置は、表示信号を保持または遅延させるフィールド遅延回路14を具備する。遅延回路14により遅延された表示信号は、時間軸フィルター回路16及び極性反転回路18において使用され、信号処理が行われる。これらの回路16、18で処理された信号は液晶表示部20に供給され、ここで画像が表示される。遅延回路14に入力側には、ビット数削減回路12が配設され、遅延回路14へ入力される表示信号の階調数が、液晶表示部20に表示する階調数よりも少ない階調数とされる。
請求項（抜粋）：
表示信号を保持または遅延させる保持/遅延手段と、前記保持/遅延手段により遅延させた表示信号を用いて信号処理を行う信号処理手段と、前記信号処理手段から供給される信号に従って画像を表示する表示部と、を有する表示装置において、前記保持/遅延手段へ入力する表示信号の階調数を、前記表示部に表示する階調数よりも少ない階調数とする削減手段を具備することを特徴とする表示装置。
IPC (2件)：
G09G 3/36
, G02F 1/133 575
G09G 3/36
, G02F 1/133 575
