特許

J-GLOBAL ID：200903090685856209

共通バッファ型スイッチ

発明者： 松山 信仁 ,  大谷 嗣朗 ,  須貝 和雄 ,  伊勢 省二 ,  河村 秀典
出願人/特許権者： 株式会社日立製作所 ,  株式会社日立インフォメーションテクノロジー
代理人 (1件)： 筒井 大和
公報種別：公開公報
出願番号（国際出願番号）：特願平9-281930
公開番号（公開出願番号）：特開平11-122257
出願日： 1997年10月15日
公開日（公表日）： 1999年04月30日
要約：

【要約】【課題】 セルバッファアドレスポインタFIFOの数を大幅に増加させることなく、高効率なトラフィック制御を行う。【解決手段】 共通バッファ制御部8は、使用するセルバッファアドレスFIFO番号を取得し、セルを共通バッファ4に格納するアドレスを空きアドレスFIFO10から取得し、共通バッファ4に転送されたセルのヘッダ、ペイロードを共通バッファ4に書き込み、空きアドレスFIFO10から取得したアドレスを対応するセルバッファアドレスポインタFIFO111 〜11n にキューイングする。キューイングされたセルは共通バッファ制御部8のセル出力タイミングに基づきセルバッファアドレスポインタFIFO111 〜11n から格納セルアドレスを読み出して共通バッファ4に格納されたセルを読み出してセルを出力し、レベルの高いクラスほど優先的に読み出す。

請求項（抜粋）：

セルを共通バッファに一時的に記憶し、読み出し順序を制御することによりルーティングを行う共通バッファ型スイッチであって、前記共通バッファに格納されたセルがキューを構成するように前記共通バッファ内のセル格納アドレスを順次記憶する複数のセルバッファアドレスポインタFIFOと、前記セルバッファアドレスポインタFIFOの各々における出力ポートの割り当てならびに優先クラスの割り当てを行うFIFO割り当てテーブルが格納された第1の格納部と、前記第1の格納部のFIFO割り当てテーブルに定義された情報に基づいてセルのキューイングを制御する共通バッファ制御部とを備えたことを特徴とする共通バッファ型スイッチ。

IPC (2件)：

H04L 12/28 ,  H04Q 3/00

FI (3件)：

H04L 11/20 H ,  H04Q 3/00 ,  H04L 11/20 G