特許
J-GLOBAL ID：200903098622512810
出力短絡保護回路
発明者：
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出願人/特許権者：
代理人 (1件)：
古澤 俊明 (外1名)
公報種別：公開公報
出願番号（国際出願番号）：特願平5-112109
公開番号（公開出願番号）：特開平6-311734
出願日： 1993年04月15日
公開日（公表日）： 1994年11月04日
要約：
【要約】【目的】 安定で確実な出力保護機能が得られ、かつ、電源回路の小型化を図ることを目的とする。【構成】 PWM制御回路57で制御されるスイッチング電源において、スイッチ素子14のオン時の電流をオン抵抗による電圧降下として検出する検出部49と、この検出部49の出力電圧が一定値を越えたとき出力してスイッチ素子14のオン時間を制限するようにPWM制御回路57を制御するコンパレータ56とを具備してなるものである。スイッチ素子14がオンしたときの飽和電圧は、オン抵抗によるスイッチ素子14の通過電流に正比例するため、スイッチ素子14がオンで、かつ、出力短絡などで過大電流が流れる場合のドレイン電流をオン抵抗による電圧降下として検出し、この電圧と、基準電圧をコンパレータ56で比較した信号を、PWM制御回路57の時比率制御端子に帰還する。検出部49の電圧が基準電圧を越えると、スイッチ素子14のオン時間を狭くして過電流保護を行う。
請求項（抜粋）：
直流入力電圧をスイッチ素子14によりオン、オフし、そのパルス幅を電圧の変動に対応してPWM制御回路57で制御して安定な出力電圧を得るようにしたスイッチング電源において、前記スイッチ素子14のオン時の電流をオン抵抗による電圧降下として検出する検出部49と、この検出部49の出力電圧が一定値を越えたとき出力してスイッチ素子14のオン時間を制限するようにPWM制御回路57を制御するコンパレータ56とを具備してなることを特徴とする出力短絡保護回路。
IPC (2件)：
引用特許：
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