特許
J-GLOBAL ID：200903099711308026
2逓倍回路
発明者：
出願人/特許権者：
代理人 (1件)：
京本 直樹 (外2名)
公報種別：公開公報
出願番号（国際出願番号）：特願平9-044140
公開番号（公開出願番号）：特開平10-242813
出願日： 1997年02月27日
公開日（公表日）： 1998年09月11日
要約：
【要約】【課題】位相回路部および掛け算回路部に位相誤差があってもデューティ比を等しくできる2逓倍回路を提供する。【解決手段】第1の入力信号vi1を所定の位相値に移相された第2の入力信号vi2を生成する位相回路部を有し、第1および第2の入力信号vi1およびvi2の差電圧を電流変換し第1の入力信号に対して周期が逓倍された2逓倍信号を生成する双差動形式の掛け算回路部を用いて、第2の入力信号vi2の位相値に対して2逓倍信号が進相または遅相しても所定の位相値に補正する帰還手段により2逓倍信号のデューティ比を等しくする。
請求項（抜粋）：
第1の入力信号を予め定める所定の位相値に移相させて第2の入力信号を生成する位相回路部を有し、前記第1および前記第2の入力信号の差電圧を電流変換し前記第1の入力信号に対して周期が逓倍された2逓倍信号を生成する双差動形式の掛け算回路部を用いた2逓倍回路において、前記第2の入力信号の前記所定の位相値に対して前記2逓倍信号が進相または遅相したことを検知して前記所定の位相値に戻すように補正する帰還手段により前記2逓倍信号のデューティ比を等しくすることを特徴とする2逓倍回路。
IPC (2件)：
FI (2件)：
引用特許：
審査官引用 (2件)
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特開昭62-233904
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特開昭60-116220
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