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J-GLOBAL ID：201002021594755774   整理番号：77A0316670

二重デプリーションCMOSによるスタティック・メモリセル

Dual depletion CMOS (D2CMOS) static memory cell.
著者 (2件)：
TAKAGI H

TAKAGI H について

, 
KANO G

KANO G について


資料名：
IEEE J Solid-State Circuit  (IEEE Journal of Solid-State Circuits)

IEEE J Solid-State Circuit について


巻： 12  号： 4  ページ： 424-426  発行年： 1977年 
JST資料番号： B0761A  ISSN： 0018-9200  CODEN： IJSCB  資料種別： 逐次刊行物 (A)
記事区分： 短報  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)
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新形のスタティック・メモリセルであるデュアルデプリーションC...
シソーラス用語：
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MOS集積回路

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メモリセル

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