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J-GLOBAL ID:201002215023152435   整理番号:10A0277174

CuAl合金配線を適用した32nmノード対応高信頼性配線技術の開発

Optimization of Metallization Processes for 32-nm-node Highly Reliable Ultralow-k (k=2.4)/Cu Multilevel Interconnects Incorporating a Bilayer Low-k Barrier Cap (k=3.9)
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巻: 109  号: 412(SDM2009 182-192)  ページ: 25-29  発行年: 2010年01月29日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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CuAl合金シードプロセスを低誘電率層間膜(k=2.4)と低誘電率積層バリア膜(k=3.9)を用いた32nmノード配線構造へ適用し,過剰な配線抵抗上昇のない高信頼性配線を実現した。Cuめっき後アニールを高温・短時間で行うことで,Cuグレイン成長を促進させつつ,CuAl合金シード膜からCuめっき膜中へのAlの過剰な抜けを抑制した。その結果,Al添加による配線抵抗上昇を抑制(pure Cu比で+10%程度に抑制)しつつ,Cu/バリアキャップ膜界面に配線信頼性を向上させるに十分なAlを偏析させることに成功した。本プロセスの適用により,EM寿命向上およびSiV不良抑制効果が実証された。(著者抄録)
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分類 (2件):
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固体デバイス製造技術一般  ,  固体デバイス計測・試験・信頼性 
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