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J-GLOBAL ID:201002218432968802   整理番号:10A0053580

マルチコアプロセッサにおける並列メモリ系のための部分アクセス競合解消プログラマブルアドレスシャフラー

Partial access conflict-relieving programmable address shuffler for parallel memory system in multi-core processor
著者 (2件):
資料名:
巻: 34  号:ページ: 1-13  発行年: 2010年02月 
JST資料番号: H0781A  ISSN: 0141-9331  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: オランダ (NLD)  言語: 英語 (EN)
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分類 (2件):
分類
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記憶装置  ,  入出力インタフェイス 
タイトルに関連する用語 (4件):
タイトルに関連する用語
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