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J-GLOBAL ID:201002231517056515   整理番号:10A0714227

格子整合InAlN/AlN/GaN HFET構造のストレステスト測定

Stress test measurements of lattice-matched InAlN/AlN/GaN HFET structures
著者 (12件):
資料名:
巻: 207  号:ページ: 1345-1347  発行年: 2010年06月 
JST資料番号: D0774A  ISSN: 1862-6300  CODEN: PSSABA  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: ドイツ (DEU)  言語: 英語 (EN)
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InAlN/AlN/GaNへテロ構造は既存のAlGaN/GaNへテロ構造にと比較してHFETデバイス応用の観点で,広いバンドギャップあるいはGaNに対する格子整合を満たすなどの利点がある。この中でも,ストレス条件下でデバイスの信頼性に及ぼすホットエレクトロンとホットフォノン効果の影響を分離できることに着目した。格子整合InAlNベースHFETを電気的ストレステストに供し,最大ドレイン電流に対応するデバイス劣化を調べた。この結果,劣化速度は狭い中庸なゲート電圧範囲で,2DEG密度が9~10×1012cm-2に対応する場合にのみ低くなることが分かった。この劣化は電子密度の関数としての劣化速度がホットフォノン寿命にによって決まることから,ホットフォノン効果に基づくことを提案した。
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分類 (2件):
分類
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トランジスタ  ,  13-15族化合物を含む半導体-半導体接合 

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