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J-GLOBAL ID:201002240995863778   整理番号:10A0352890

低電圧低電力で線形性を改善したCMOSアクティブ抵抗回路

Low-voltage low-power improved linearity CMOS active resistor circuits
著者 (2件):
資料名:
巻: 62  号:ページ: 373-387  発行年: 2010年03月 
JST資料番号: W0439A  ISSN: 0925-1030  CODEN: AICPEF  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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CMOS技術の微細化に対応した浮遊ゲートMOS(FGMOS)トランジスタによるアクティブな抵抗回路の実装設計を解説した。差動増幅ベースの回路,相補計算回路,オーム則ミラーリング,線形化技術,対称構造化などの理論解析を行った。線形性の改善,2次効果による誤差の補償,面積の最小化など技術を取り入れたFGMOSアクティブ抵抗回路の解析と実装設計を行った。周波数応答の改善のために,総てのMOSFETを飽和領域にバイアスし,重要な部分を電流モード動作にした。設計パラメータにより負性抵抗回路も得られる。SPICEシミュレーションで理論推定値を検証した。線形性誤差は最善で0.15%以下になった。提案の回路は低電圧低電力要求に対応できる。
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分類 (3件):
分類
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LCR部品  ,  その他の電子回路  ,  半導体集積回路 
タイトルに関連する用語 (5件):
タイトルに関連する用語
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