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J-GLOBAL ID:201002288555684122   整理番号:10A1145230

AASH:ハイパーバイザのための非対称認識スケジューラ

AASH: An Asymmetry-Aware Scheduler for Hypervisors
著者 (3件):
資料名:
巻: 45  号:ページ: 85-96  発行年: 2010年07月 
JST資料番号: D0915A  ISSN: 0362-1340  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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非対称マルチコアプロセッサ(AMP)は,同じ命令セットアーキテクチャーを表わすが異なる性能(クロック周波数,電力消費など)のコアを持ち,通常複数の高速コアと多数の低速コアからなる。AMPsは命令ストリームを最適コアに割付けるため,既存の対称マルチコアプロセッサよりも電力・面積効率に優れる。スレッドの効果的なコア適合には非対称認識スレッドスケジューラが必要だが,対称認識スケジューラに比してハイパーバイザにおける非対称認識への取組みはない。仮想機械ハイパーバイザにおける最初の非対称支援の実装として,AASH(機能・設計・実装・評価)を提示した。AASHを利用して,ハイパーバイザスケジューラにおける非対称の影響を,性能およびオーバーヘッドの観点から評価できる。AMPシステムの支援を比較的効率的に実装でき,大部分の作業負荷(実験の36%迄)に関して計測可能な性能利得をもたらした。
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