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J-GLOBAL ID:201102265751275327   整理番号:11A1686344

時分割多重を用いる単一受信機によるアダプティブアレーのアナログ回路削減に関する検討

A Study of Scale Reduction of Analog Circuits for an Adaptive Array with a Single Receiver Using Time-Division Multiplexing
著者 (8件):
資料名:
巻: 111  号: 200(AP2011 64-76)  ページ: 7-12  発行年: 2011年09月01日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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アダプティブアレーアンテナにおける回路規模の削減手法について提案する。従来のアダプティブアレーアンテナでは,フィルタ,アンプ,ダウンコンバータ,ADコンバータ等の回路がアンテナごとに必要となるため,1アンテナのシステムと比較し大規模なアナログ回路が必要となるという課題が存在する。これを解決する方法として,スイッチによる時分割多重を用い,アンプとフィルタ以外を共用し1系統化することで,アナログ回路を削減する手法が過去に提案されている。しかしこの手法では,スイッチ切換により生じる電力損失が大きく,アンプに高い性能が求められるという問題が存在する。そこで本検討では,スイッチ切換による電力損失を抑制し,アンプについても,1系統化することでアナログ回路を削減する方法について提案する。そして,シミュレーションにより従来のアダプティブアレーアンテナと提案法の特性を比較し,提案法の有効性を明らかにする。(著者抄録)
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