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J-GLOBAL ID:201102273641560835   整理番号:11A0424857

モデルベース開発とPILS(Processor In Loop Simulation)を活用した組込み向け超並列プロセッサのソフトウェア開発

著者 (3件):
資料名:
巻: 94  号:ページ: 141-146  発行年: 2011年02月01日 
JST資料番号: F0019A  ISSN: 0913-5693  資料種別: 逐次刊行物 (A)
記事区分: 解説  発行国: 日本 (JPN)  言語: 日本語 (JA)
抄録/ポイント:
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組込み機器に画像処理・画像認識アプリケーションを応用するためには,演算性能や消費電力などの制約を満たしながら,必要な性能を実現することが求められる。このためには,専用のハードウェアや並列プロセッサを活用し,これらのアクセラレータを含む組込みシステムでのソフトウェア開発が必要となる。本稿では,組込みシステムへの画像認識アプリケーションの実装について,ハードウェア・ソフトウェアの両面から,その要素技術と今後の応用展開について解説する。(著者抄録)
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分類 (2件):
分類
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図形・画像処理一般  ,  計算機システム開発 

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