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J-GLOBAL ID:201102297249543104   整理番号:11A1404582

SNRと電力散逸の二重制限を有するΣΔ変調器における積分器の変数最適化

Parameters Optimization of Integrators inΣΔModulator with Dual Restrictions of SNR and Power Dissipation
著者 (3件):
資料名:
巻: 27  号:ページ: 13-16  発行年: 2010年 
JST資料番号: C2387A  ISSN: 1000-7180  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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フィードフォワード翼列ΣΔ変調器の信号対ノイズ比と電力散逸の間関係と分類-操作相互コンダクタンス増幅器から構成されるスイッチドキャパシタ積分器のそれらについて詳細に解析した。この解析に基づいて,信号対ノイズ比と電力散逸の両方の制限を有するΣΔ変調器における積分器の最適値を,表現において与えて,それは,サンプルコンデンサ,スイッチの抵抗器,入力トランジスタの幅と長さの比率その他を含んだ。本最適選択は,両方の制限を有する優れた設計を持つことが,低出力高解像度のΣΔADCデザイナにとって良くて,それは,詳細な回路設計に参照を与えて,設計サイクルを減少するためにも良かった。Data from the ScienceChina, LCAS. Translated by JST
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