特許
J-GLOBAL ID：201103063480272795
パルス発生回路
発明者：
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出願人/特許権者：
代理人 (1件)：
伊丹 勝
公報種別：特許公報
出願番号（国際出願番号）：特願2000-157876
公開番号（公開出願番号）：特開2001-339284
特許番号：特許第3559749号
出願日： 2000年05月29日
公開日（公表日）： 2001年12月07日
請求項（抜粋）：
【請求項1】入力信号の第1レベルから第2レベルへの第1の遷移点を検知してセットされる第1のラッチ回路と、前記入力信号の第2レベルから第1レベルへの第2の遷移点を検知してセットされる第2のラッチ回路と、前記第1のラッチ回路の出力と前記入力信号の論理積により、前記入力信号の第1の遷移点に続く第2レベルから第1レベルへの第3の遷移点でレベル変化する出力を出す第1の論理ゲートと、前記第2のラッチ回路の出力と前記入力信号の論理積により、前記入力信号の第2の遷移点に続く第1のレベルから第2のレベルへの第4の遷移点でレベル変化する出力を出す第2の論理ゲートと、前記第1の論理ゲートの出力のエッジに同期して一定のパルス幅の第1のパルス信号を出力する第1のエッジ検出回路と、前記第2の論理ゲートの出力のエッジに同期して前記第1のパルス信号と同じパルス幅の第2のパルス信号を出力する第2のエッジ検出回路と、前記第1のエッジ検出回路から得られる第1のパルス信号の後端エッジで前記第1のラッチ回路をリセットするリセット信号を発生する第1のリセット回路と、前記第2のエッジ検出回路から得られる第2のパルス信号の後端エッジで前記第2のラッチ回路をリセットするリセット信号を発生する第2のリセット回路とを有することを特徴とするパルス発生回路。
IPC (1件)：
FI (1件)：
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