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J-GLOBAL ID:201202224433218178   整理番号:12A0345194

電源電圧ドメインと1/f雑音低減を組み合わせた,バイアス電流共通のRFおよびベースバンド段を採用した電力効率の良い受信機アーキテクチャ

A Power-Efficient Receiver Architecture Employing Bias-Current-Shared RF and Baseband With Merged Supply Voltage Domains and 1/f Noise Reduction
著者 (2件):
資料名:
巻: 47  号:ページ: 381-391  発行年: 2012年02月 
JST資料番号: B0761A  ISSN: 0018-9200  CODEN: IJSCBC  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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周波数変換に受動整流ミキサを用いたダウンコンバータを採用した,電力効率の良い直交受信機を提案した。そのアーキテクチャは,全電源電圧を各段に使えるようにしながら,RFとベースバンド段の間のバイアス電流の共通化を用いている。受信機は,0.18μm CMOS技術で実現した。プロトタイプは44.5dBの最大変換利得,4.3dBのNF,20dBVのチャネル内OIP3,を達成し,1.8V電源から各直交パスにおいて2.2mAを消費した。この性能は,集積化インダクタなしで達成でき,そのため,0.5mm2の小さなダイ面積で済んだ。
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分類 (1件):
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無線通信一般 

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