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J-GLOBAL ID:201202291078413974   整理番号:12A0607974

競合解消をもつ面積効率の良い再構成可能LDPC復号器

An Area-Efficient Reconfigurable LDPC Decoder with Conflict Resolution
著者 (5件):
資料名:
巻: E95-C  号:ページ: 478-486 (J-STAGE)  発行年: 2012年 
JST資料番号: L1370A  ISSN: 0916-8524  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 英語 (EN)
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本論文では,ターボ復号化メッセージパッシング(TDMP)およびNormalized Min-Sum(NMS)アルゴリズムに基づき,構造化および非構造化LDPC符号を支援する面積効率のよいLDPC復号器を提案した。TDMPアルゴリズムにより起こるメモリアクセス競合問題を解決するために1つの解を導入した。また,主タイミングスケジュールを注意深く準備し,解を取り扱い,一方更なるハードウエア追加を回避した。必要なメモリビットを低減するために,外部メッセージ蓄積方式についても最適化した。更に,外部メッセージの回復および蓄積操作を共に融合した。提案したアーキテクチャを検証するために,中華人民共和国携帯マルチメディア放送(CMMB)およびディジタル地上/テレビマルチメディア放送(DTMB)標準双方に準拠するLDPC復号器を,SMIC 0.13μm標準CMOS工程を用いて開発した。コア面積は,4.75mm2,最大動作クロック周波数は200MHzであった。推定電力消費は,5繰返しおよび供給電圧1.2Vに対してCMMBに対して25MHzで48.4mW,DTMBに対して50MHzで130.9mWであった。(翻訳著者抄録)
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分類 (2件):
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半導体集積回路  ,  テレビジョン一般 
引用文献 (17件):
  • GALLAGER, R. G. Low density parity check codes. IEEE Trans. Inf. Theory. 1962, 8, 1, 21-28
  • SUN, Y. A low-power 1-Gbps reconfigurable LDPC decoder design for multiple 4G wireless standards. Proc. IEEE SOC Conference, Sept. 2008. 2008, 367-370
  • MASERA, G. Implementation of a Flexible LDPC Decoder. IEEE Trans. Circuits Syst. 2007, 54, 6, 542-546
  • Framing Structure, Channel Coding and Modulation for Broadcasting Channel
  • digital terrestrial television broadcasting transmission system frame structure, channel coding and modulation. Quality Supervision and Quarantine, GB 20600-2006. 2006
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