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J-GLOBAL ID:201302209047953872   整理番号:13A1269432

FPGAに基づくFFT畳込みの実装

IMPLEMENTATION OF FPGA-BASED FFT CONVOLUTION
著者 (4件):
資料名:
巻: 603  ページ: 425-428  発行年: 2012年 
JST資料番号: B0665A  ISSN: 0537-9989  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: イギリス (GBR)  言語: 英語 (EN)
抄録/ポイント:
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ストリーミングデータにFFT畳込みを適用するには,複数のFFTブロックを用いて多重化によりストリーミングデータを信号処理する必要がある。本稿ではハードウェア資源を低減するために,ゼロパッド入力データに対する新しいFFT構造を提案したが,それはFFT畳込みに用いたFFTに対する基数4構造の改良設計であった。129のフィルタ長について提案構造を実現したが,その他のフィルタ長に対しても拡張することができた。実装の目標とするデバイスはXilinx Virtex5 FPGAであった。また提案設計によれば,ハードウェア資源を削減でき,遅れを短縮して市販のIPコアと同等のスループットと精度を実現できた。現在の設計では市販のIPコアと同数の乗算器を用いたが,それによりFFT段階での乗算器共用が可能となった。
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分類 (1件):
分類
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信号理論 
タイトルに関連する用語 (4件):
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